Altifigence Academy

13 / 37 · Verifica

Verifica del progetto: equivalenza della selezione e osservazione

Distinguere verifiche basate sulla sola tabella da quelle che richiedono osservazione del clock.

Leggere le condizioni e disegnare la sequenza temporale

y=s‾a+sby=\overline s a+sb è combinatorio; sampled_y memorizza y al fronte di salitaFronte di salita Passaggio del clock da 0 a 1, distinto dall’intero intervallo di livello CLK=1. Approfondisci. Supponiamo acquisito una volta a=1,b=0,s=0a=1,b=0,s=0. Poi s viene portato a 1 fra i fronti.

La domanda riguarda il valore dopo stabilizzazione degli ingressi e ritardo logico, ma prima del prossimo fronte di salita. Equivalenza funzionale e istante di osservazione del registroRegistro Memorizza uno stato di più bit. I registri sincroni del corso acquisiscono gli ingressi specificati al fronte di clock. Approfondisci sono verifiche distinte.

La sequenza seguente usa queste condizioni con a=1, b=0. Nell'intervallo in cui le uscite differiscono spiegate quale segnale rappresenta l'ingresso attuale e quale una precedente acquisizione.

Variazioni fra i fronti e valore memorizzato
Mostra i dati della forma d’onda
Dati della forma d’onda: ogni carattere è un intervallo; il punto mantiene lo stato precedente; p è un ciclo di clock.
SegnaleForma d’ondaValori del bus
event234captured → sel changes → next edge
sel01.
y10.
sampled_y1.0

Altri problemi di progetto

  1. Dimostrate con otto combinazioni l'equivalenza di y=(a & ~s) | (b & s) a un MUXMultiplexer Circuito combinatorio che collega un ingresso all’uscita secondo la selezione. Va specificata la corrispondenza fra bit di selezione e ingressi. Approfondisci a un bit.
  2. Togliendo sampled_y la formula resta uguale: quale proprietà temporale scompare?
  3. Perché valori RTL ideali non garantiscono il comportamento reale se il cambio di s è troppo vicino al fronte di salita?

Prova tu

Testare un MUX a quattro bit solo con a=b rileva la selezione invertita?

Leggi la spiegazione

No. Dati uguali danno lo stesso risultato con qualsiasi selezione. Provate per esempio a=0101, b=1010 sia con s=0 sia con s=1 per distinguere polarità e trasferimento dei bit.

Nelle condizioni indicate, quanto vale (y, sampled_y) subito prima del prossimo fronte di salita?

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